Im Datenblatt ( 6. I/O Multiplexing) steht zu Pin B3 und B4: Usart Tx Rx. Normal liegen die auf Pin D0 und D1. In welchem Register können die Umgeschaltet werden ? Oder ist es nur ein Datenblattfehler?
Alternative Usart Pin beim Atmega8A
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Ich denke, das ist ein Fehler. Das wäre miso und mosi, was man verwenden 'könnte' und dann somit SPI lahmlegen würde. Das wäre doch Quatsch.Raum für Notizen
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tschoeatsch schrieb:
Das wäre doch Quatsch
Es gibt viele Anwendungen, bei denen die SPI nur zum Flashen der Firmware benötigt wird. Die Pins liegen danach oft brach. Von daher macht es Sinn, denn dann hätte man z.B. einen vollen Port D zur Verfügung, wenn man das bräuchte.
Aber wo die Pins umgeschaltet werden sollen weiß ich auch nicht.
Das UART-Blockschaltbild macht keine Andeutungen.
Auch die Beschreibung der Pins D0, D1 bzw. an B3 oder B4 wird nichts beschrieben.
Auch die Register-Beschreibung des UARTs UCSRA bis UCSRC bingt keinen Hinweis.
Vielleicht ist es wirklich falsch im Datenblatt plaziert (copy paste Fehler). -
Hab't ihr ein altes DB? Meins ist von 09.2015 und da ist von dem nicht die Rede
portb.PNGRaum für Notizen
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Pluto25,
schmeiß weg! Muß ein altes fehlerhaftes DB sein, schau mal bei microchip nach, da ist das offensichtlich berichtigt. DB sind dort von 2017/2018. -
Ich habe in einer deutschen Übersetzung der PDF-Datei www-user.tu-chemnitz.de/~heha/viewchm.php/hs/ATmegaX8.chm/ folgendes gefunden:
Der universelle serielle Datensender/-empfänger (USART) kann in einen SPI-kompatiblen Master-Betriebsmodus versetzt werden. Werden beide UMSELn1:0-Bits gesetzt, wird die USART-interne MSPIM-Logik aktiviert. In dieser Betriebsart übernimmt die SPI-Master-Steuerlogik die Kontrolle über die USART-Ressourcen. Die Ressourcen umfassen die Sende- und Empfangsschieberegister und -Puffer sowie den Baudraten-Generator. Der Paritätsgenerator und -prüfer, die Daten- und Taktwiederherstellungslogik sowie die RX- und TX-Steuerlogik sind abgeschaltet. Die USART-eigene RX- und TX-Steuerlogik wird durch eine gemeinsame SPI-Transfersteuerlogik ersetzt. Andererseits ist die Pin-Steuerlogik und Interrupterzeugungslogik identisch in beiden Betriebsmodi. Die Lage der I/O-Register ist die gleich in beiden Betriebsmodi, aber ein Teil der Funktionalität der Steuerregister ändert sich bei Nutzung des MSPIM.
Vielleicht hilft es ja weiter...Versuch macht klug !
Dieser Beitrag wurde bereits 1 mal editiert, zuletzt von Cable ()
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Die Tabelle passt ja garnicht zum chip. Da werden ja nur 14 pins beschrieben und die pin-Nummern passen nicht zur Funktion. Ich würde jetzt diese Seite vom DB weg schmeißen oder durchxsen, äh, durchicksen, halt durchstreichen.Raum für Notizen
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tschoeatsch schrieb:
Die Tabelle passt ja garnicht zum chip
Das werd ich mir bei nächster Gelegenheit mal näher betrachten. Wäre vermutlich besser als eine Softwarelösung. Zumal die wieder Port D "schreddern" müsste weil dort die einzigen Ints sind. -